标签：modlsim Sum carryout carryin 加法器 进位 overflow reg 溢出

1.实验工具：
电脑和Quartur ii软件和modlsim软件。
2.实验过程：
第一步：打开modlsim。
第二步：新建 Project。
第三步：代码输入。
第四步：保存。
第五步：编译。
第六步：生成测试文件。
第七步：进行仿真。
第八步：进行调试。

代码：module addem (carryin,X, Y, S,carryout,overflow);
parameter n=32;
input carryin;
input [n-1:0] X, Y;
output reg [n-1:0] S;
output reg carryout, overflow;
reg [n:0] Sum;
always @ X,Y,carryin)
begin
Sum=[1’b0, X + (1'b0, Y) + carryin;
S=Sum[n-1:0];
carryout= Sum[n];
overflow=(X[a-1]& Y[a-1]&~S[n-1]) |(~X[n-1]&～Y[a-1]& S[a-1D;end
endmodule

截图：

标签：modlsim,Sum,carryout,carryin,加法器,进位,overflow,reg,溢出
来源： https://blog.csdn.net/qq_54039725/article/details/118277974

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